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楼主: STMCU

[活动] 中奖名单来啦丨有“料”才任性,干货好礼一起拿

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蝴蝶豆

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发表于 2020-4-30 14:19:37 | 显示全部楼层
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蝴蝶豆

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2020-12-9
发表于 2020-4-30 15:33:10 | 显示全部楼层
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STM32G0 系列不仅作为一款全新的 Arm® Cortex®-M0+ 微控制器,还为高效能微控制器树立了新的标杆。此系列产品在每个细节上都实现了最出色的优化,可为您提供最佳的性价比,让您以最低的 BOM 成本和更好的灵活性来满足应用需求。STM32G0 系列实现了万能架构 (one-architecture-fits-all) 的概念,以满足未来的市场需求。STM32G0 系列高效、可靠而易用,提供 16 KB 到 512 KB片内 Flash,采用 8 引脚到 100 引脚封装,可满足各种应用和细分市场的需求。
G0只有1个电源对(VDD/VSS),其他的系统引脚均可配置成GPIO,默认的SRAM存储器为36KB,不带奇偶校验,使能奇偶校验时,SRAM的高4KB用于奇偶校验.在这种情况下,因此有必要更新应用程序中
的内存描述文件而不是使用默认的配置,启用SRAM奇偶校验时,若发生ECC故障会触发NMI,通过SYSCFG寄存器中的SRAM_PARITY_LOCK配置,可以使得同样的错误也可以链接到,TIM1/15/16/17的BRK_IN刹车输入。G0的RCC模块与F0的相似却有一些增强。
7 种低功耗模式带快速唤醒
低至33 nA 仍可用 I/O 唤醒
低至870 nA 仍可有 36 KB RAM 保留能力
很多种外设可以从低功耗模式下唤醒MCU
在运行模式下低至98.3 µA / MHz
VBAT模式依旧可以保持RTC和备份寄存器的内容
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蝴蝶豆

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发表于 2020-4-30 16:24:14 | 显示全部楼层
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蝴蝶豆

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发表于 2020-4-30 16:28:15 | 显示全部楼层
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蝴蝶豆

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发表于 2020-4-30 17:13:21 | 显示全部楼层
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蝴蝶豆

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2020-12-6
发表于 2020-4-30 18:41:59 | 显示全部楼层
         STM32H7xx作为ST的高性能MCU,功能极其强大,最新的H7x5和H7x7系列更是集成了Arm Cortex-M7和Cortex-M4双核。无论是指令读取还是数据传递,STM32H7xx其强大的性能都离不开MCU总线的支持。工作中使用了STM32系列的MCU,知道数据总线、时钟总线等,都留于应用层面,未有深入学习。这次借此机下载了STM32H7_Technical_Training_CN文档,在较新的STM32H7xx系列MCU上会学习一下MCU总线的相关知识。


st-20200430-1.png

STM32H7xx 功能区域
         STM32H7xx内部分为3个域,处理域D1、外设域D2和低功耗域D3
         处理域D1提供处理和图形能力,包含400MHzCortex-M7CoreJPEG CodecDMA2DLTDC三大图形组件,2x 1MB 带有错误检查和纠正(ECC)功能的独立Flash,带有错误检查和纠正(ECC)功能的704KB512+128+64SRAM,以及一些外设(FMCQuadSPISD/MMC)。
         外设域D2提供了外设管理,包含DMA1/2USB ETH CANTimerSPIUART等常规外设,以及带有错误检查和纠正(ECC)功能的288KB128+128+32SRAMD2域独立的SRAMs可以作为本区域外设DMAs数据的输入输出的缓存,再通过MDMA可以将数据转移到处理域D1
         低功耗域D3提供系统管理和低功耗操作模式特性。包含BDMA(基本的直接内存访问控制器)、I2CSPISAIADC,低功耗外设LPTIMLPUART,时钟管理、GPIO等外设,以及带有错误检查和纠正(ECC)功能的64KB SRAM。当D1D2域进入DStandby(域关闭)模式时,D3 SRAM用来保留数据。
STM32H7xx总线矩阵
         STM32H7xx3个总线矩阵。一个AXI总线矩阵和两个AHB总线矩阵。三个总线矩阵之间通过公平仲裁循环算法和优先级驱动仲裁(QoS能力),实现系统和外围设备同时操作。且在多个主设备同时激活的情况,能有效的移除总线的堵塞。
         AXI总线和AHB总线最大频率200MHzAPB总线最大频率100MHz
         AXI总线矩阵在D1域,AHB总线矩阵在D2域和D3域。总线之间有5 AHB-to-APB2 AXI-to-AHBBus-to-bus桥梁链路。

st-20200430-2.png

STM32H7xx - AXI 互连
         AXI总线为64-bit总线,通过可独立配置优先级的优先级仲裁,来保证多个AXI主外设同时发起访问同一个AXI从外设时不至于堵塞。
         AXI主外设包含D2 AHBCortex-M7CoreSDMMC1MDMAMDA2DLTDCAXI从外设包含AXI/AHB bridge to D3AXI/AHB bridge to D2FLASH AFLASH BFMCQSPI以及AXI  SRAM。其中除D2 AHBSDMMC1AXI/AHBbridge to D3AXI/AHB bridge to D232-bit总线外,其他都为64-bit总线。
         AXI总线上还有一个缺省AXI从设备(Default slave),用来处理非法地址空间的操作请求,来保证AXI总线不会被堵塞。

      总的来说,MCU上的总线承载着MCU所有指令及数据的传递,是MCU中内核和各个外设之间的桥梁。总线的性能虽不能提升MCU的处理性能,但能为MCU的强大性能提供强力的支持。




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