你的浏览器版本过低,可能导致网站不能正常访问!
为了你能正常使用网站功能,请使用这些浏览器。

CPU IO口开漏输出设置问题

[复制链接]
斯文人 提问时间:2019-3-30 19:13 /
阅读主题, 点击返回1楼
收藏 评论13 发布时间:2019-3-30 19:13
13个回答
五哥1 回答时间:2019-4-1 17:09:05
都是下拉电阻惹的祸

评分

参与人数 1蝴蝶豆 +2 收起 理由
STMCU + 2

查看全部评分

aiherong 回答时间:2019-4-4 04:05:19
上次还没讲清楚,按这次试下一定要设成开漏模式吗?)
5V-LED-C极;GPIO-10k-b极;e极-1k-地;GPIO外接10k电阻上拉(直接在IO口上)
1k起负反馈并限流作用,到时根据亮度调整。PNP型不适合开漏io方式控制,
看一下模电书籍中关于三极管基本放大电路能够使你对这一问题有更清晰了解
斯文人 回答时间:2019-4-5 13:57:23
aiherong 发表于 2019-4-4 04:05
上次还没讲清楚,按这次试下一定要设成开漏模式吗?)
5V-LED-C极;GPIO-10k-b极;e极-1k-地;GPIO外接10k电阻 ...

为啥PNP不适合设置成开漏模式
aiherong 回答时间:2019-4-7 04:18:02
原意是开漏模式的IO不适宜接PNP管子!不容易关死
12

所属标签

相似问题

关于意法半导体
我们是谁
投资者关系
意法半导体可持续发展举措
创新与技术
招聘信息
联系我们
联系ST分支机构
寻找销售人员和分销渠道
社区
媒体中心
活动与培训
隐私策略
隐私策略
Cookies管理
行使您的权利
关注我们
st-img 微信公众号
st-img 手机版