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隐者-423522 发表于 2016-2-22 10:17:25

系统时钟和EMC性能

在进行静电测试时，发现STM32的系统时钟配置为SYSCLK_FREQ_HSE就不能通过实验。而使用其他系统时钟配置都可以。00110 /* #define SYSCLK_FREQ_HSE    HSE_VALUE */00111 /* #define SYSCLK_FREQ_24MHz24000000 */ 00112 /* #define SYSCLK_FREQ_36MHz36000000 */00113 /* #define SYSCLK_FREQ_48MHz48000000 */00114 /* #define SYSCLK_FREQ_56MHz56000000 */00115 #define SYSCLK_FREQ_72MHz72000000对比了代码的不同之处，SYSCLK_FREQ_HSE选择HSE，而其他方式选择PLLCLK。而在system_stm32f10x.c void SetSysClockToHSE(void) 程序下加入了PLL/2*2，启动了PLL就可以通过测试了。

沐紫 发表于 2016-2-22 10:24:21

谢谢楼主:)

sfee2002 发表于 2016-2-23 09:31:24

没测试过:):):):)

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